 班級規模及環境--熱線:4008699035 手機:15921673576( 微信同號) |
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每期人數限3到5人。 |
| 上課時間和地點 |
上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領館區1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協同大廈
最近開課時間(周末班/連續班/晚班）：2020年3月16日 |
| 實驗設備 |
☆資深工程師授課
☆注重質量
☆邊講邊練
☆合格學員免費推薦工作
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| 質量保障 |
1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
2、培訓結束后,授課老師留給學員聯系方式,保障培訓效果,免費提供課后技術支持。
3、培訓合格學員可享受免費推薦就業機會。 |
課程大綱 |
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Cadence課程
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程目標：
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通過該課程的學習，學員應能夠對SF&VCS原理以及機制有所了解；對于該系統管理有一個系統的了解和把握，掌握基本的分析步驟和方法以及相應的工具。
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課程大綱：
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主題 |
內容 |
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Cadence-ORCAD-Capture-CIS環境介紹及原理圖庫的建立 |
創建工程，創建元件庫
分裂元件的制作方法，加入元件庫(練習) |
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Cadence-ORCAD-Capture-CIS原理圖繪制
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放置元件，同一個頁面內建立電氣互連
總線的使用方法，對原理圖中對象的基本操作，
如何添加footprint屬性，生成網表（練習) |
Cadence-allegro封裝庫的架構介紹與建立封裝庫
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Allegro-PCB界面的介紹
Allegro-PCB 封裝設計理念
Allegro-PCB SMD與DIP封裝的建立
(練習) |
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Cadence –allegro設計界面的設置與基本操作 |
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Allegro-PCB 基本操作
(練習) |
Cadence –allegro高級操作
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Allegro-PCB 規則管理器介紹
(練習) |
Cadence –allegro樣例操作1 |
網口、USB的設計規則、操作與分析
(練習) |
Cadence –allegro樣例操作2 |
DDR3的設計規則、操作與分析
(練習) |
Cadence –allegro工程文件的輸出 |
設計文件的輸出規范
(練習)
Cadence后仿真信號完整性介紹
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