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       每期人數(shù)限3到5人。
   上課時間和地點
上課地點:【上?!浚和瑵髮W(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山學(xué)院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班):2020年3月16日
   實驗設(shè)備
     ☆資深工程師授課
        
        ☆注重質(zhì)量 ☆邊講邊練

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   質(zhì)量保障

        1、培訓(xùn)過程中,如有部分內(nèi)容理解不透或消化不好,可免費在以后培訓(xùn)班中重聽;
        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。

課程大綱
 
  1. 使用 7 系列 FPGA 產(chǎn)品進行設(shè)計培訓(xùn)
    使用 7 系列 FPGA 產(chǎn)品進行設(shè)計培訓(xùn)
    Designing with the Xilinx 7 Series Families
    Full Course Outline
    ? 1
    7 Series FPGA Overview
    CLB Architecture
    Slice Flip-Flops
    Lab 1:?CLB Resources
    Memory Resources
    Lab 2: Memory Resources
    DSP Resources
    Lab 3:?DSP Resources
    ? 2
    I/O Resources
    Lab 4: I/O Resources
    Clocking Resources
    Lab 5: Clocking Resources
    Memory Controllers
    Dedicated Hardware
    Coding Techniques

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